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DAB 시스템이 요구하는 최대 출력 데이터율을 지원하는 Viterbi 디코더의 효율적인 구조를 제안하고 설계하였다.DAB 수신기에서 Viterbi 디코더는 매우 많은 연산량을 수행하는 부분이며, 이를 위하여 고속으로 동작하는 전용 하드웨어로 설계하는 것이 바람직하다.본 논문에서는 시스템의 전력소모를 줄이기 위하여 puncturing을 사용하는 Viterbi 디코더에 SST 방식을 적용하였다. 설계면적을 감소시키기 위하여 puncturing vector table을 수정ㆍ재배치하여 hardwired logic으로 구현하였으며,새로운 re-scaling 방식을 제안하여 패스 메트릭을 저장하는데 필요한 워드길이를 최적화시켰다.제안된 re-scaling 방식은 패스 메트릭을 re-scaling하는데 필요한 연산량을 크게 감소시킨다. 또한 브랜치 메트릭을 계신하는데 필요한 연산량을 줄이기 위하여 밀 계산된 값을 사용하는 방식을 제안하였다. 설계된 Viterbi 디코더는 삼성 0.35μ표준셀 라이브러리를 이용하여 합성하였으며, 작은 면적을 차지하고 전력 소모가 적음을 확인하엿다.
목차
요약
ABSTRACT
Ⅰ.서론
Ⅱ.제안된 Viterbi 디코더 구조
Ⅲ.모의 실험 및 결과
Ⅳ.결론
참고문헌
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