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Korean Institute of Information Scientists and Engineers 정보과학회논문지(A) 정보과학회논문지(A) 제22권 제10호
발행연도
1995.10
수록면
1,426 - 1,436 (11page)

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본 논문에서는 루프의 병렬화를 위해 루프의 기능한 병렬성을 탐지하고 스케쥴하는 문제를 다룬다. 최근에 집적회로 기술의 급격한 발달로 한 칩안에 파이프라이닝 연산이 이루어지도록 하는 것이 가능하며 VLIW나 슈퍼스칼라 컴퓨터에서는 파이프라이닝의 스케쥴링 문제가 발생한다. 여기에서는 고수준 언어로 표현된 루프를 데이타 종속그래프로 나타내고 이로부터 루프의 병렬성을 파악하여 그 병렬성을 나타내는 파이프라이닝 형태의 스케쥴을 얻고자 한다. 특히 단순 루프에 있는 최대한의 병렬성을 얻는 최적의 알고리즘을 제시하고자 한다. 이 알고리즘에서는 데이타 종속 그래프상의 근접한 노드 사이의 지역적 시간관계를 이용하여 이를 결합함으로써 전체적인 스케줄을 얻는 방법을 사용하였다. 제시된 알고리즘은 다항 시간의 복잡도를 가지며 최소의 지연간격을 갖는 파이프라이닝 스케쥴의 패턴을 생성한다.

목차

요약

Abstract

1. 서론

2. 프로그램의 표현

3. 최적 패턴 찾기

4. 결론

참고문헌

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