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이용수
ABSTRACT
1. 서론
2. 기존의 전원각 정보 추출 기술
3. 제안된 주파수를 제한하는 PLL 방법
4. 시뮬레이션 결과
5. 결론
참고문헌
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무정전전원장치에 적합한 새로운 전원각 정보 추출 기술
한국산학기술학회 학술대회논문집
2004 .06
무정전전원장치에 적합한 주파수 제한기와 안티 와인드업을 가지는 새로운 3상 전원각 정보 추출 방식
한국산학기술학회 논문지
2006 .12
주파수 합성기를 위한 PLL 설계 ( A Design of PLL for Frequency Synthesizer )
한국통신학회 학술대회논문집
1998 .01
주파수 합성기를 위한 PLL 설계
한국통신학회 학술대회논문집
1998 .07
가상 2상 방식을 사용한 단상 PLL 알고리즘의 성능 비교
대한전기학회 학술대회 논문집
2006 .10
실시간 시뮬레이션 시스템을 이용한 PLL 설계
Proceedings of KIIT Conference
2018 .06
초 광대역용 PLL 설계에 관한 연구
한국인터넷방송통신학회 논문지
2010 .01
디지털 신호처리 기술을 이용한 PLL에 관한 연구 ( A Study on PLL by Using DSP Techniques )
대한전자공학회 학술대회
1992 .01
A Method to Improve the Performance of Phase-Locked Loop (PLL) for a Single-Phase Inverter Under the Non-Sinusoidal Grid Voltage Conditions
전력전자학회 학술대회 논문집
2017 .11
Benchmarking of Small-signal Dynamics of single-phase PLLs
ICPE(ISPE)논문집
2015 .06
PLL 주파수 합성기에서 발생하는 위상잡음의 영향 ( The Effect on Phase Noise from PLL Frequency Synthesizer )
한국전자파학회논문지
2001 .10
연료전지 계통연계형 인버터의 Islanding에 강인한 PLL 기법
전력전자학회 학술대회 논문집
2009 .07
Double-PLL을 이용한 홀 센서 기반 PMSM 제어의 위치 추정 성능 개선
전력전자학회논문지
2017 .06
PLL 속도제어 시스템에서 LEAD 보상기 설계에 관한 연구
대한전기학회 학술대회 논문집
1988 .11
900㎒ PLL 모듈의 설계 및 위상잡음 개선의 연구
한국통신학회 학술대회논문집
2001 .07
PLL 알고리즘을 사용한 단상 및 3상 계통연계형 인버터의 동기화 기법
전력전자학회논문지
2011 .08
초고속 DH-PLL(Digital Hybrid PLL) 주파수 합성기의 설계와 동작 특성
한국통신학회 학술대회논문집
2004 .11
Module 함수를 이용한 PLL 주파수 합성 회로의 구성 ( PLL frequency synthesizer design using Module function )
대한전자공학회 학술대회
1982 .01
고주파 PLL을 위한 10~40㎓ 2분주기의 연구
대한전자공학회 학술대회
2012 .06
전차원 상태관측기를 이용한 3상 불평형 전원의 PLL 성능 개선
전력전자학회 학술대회 논문집
2007 .07
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