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한국철도학회 한국철도학회 학술발표대회논문집 한국철도학회 2000년도 춘계학술대회논문집
발행연도
2000.5
수록면
336 - 343 (8page)

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This paper proposes the failsafe control logic which has applied to the voting on the TMR system by using FPGA.
The self-detection circuit is also designed for detecting a characteristic of fault at TMR system. The fault producing in the self-detection system is largely classified among an intermittent fault, a transient fault and a permanent fault.
If it is happened to the permanent fault, the system can be failed. Therefore, it is designed the logic circuit which is not transferred the permanent fault to the system after shut off output. The control logic of the Fail Safe proposed in the paper is required for a circuit integrate of device to minimize the failure happened. Therefore, it makes to design FPGA with modeling of VHDL. The circuit of the Fail Safe of TMR system is able to apply to nuclear system, rail-way system, aerospace and aircraft system which is required for high reliability.

목차

ABSTRACT
1. 서론
2. 결함허용 시스템
3. 고장안전(Fail Safe)회로
4. 결함 모델
5. 시스템 평가
6. 실험 및 결과
7. 결론
참고문헌

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