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대한전자공학회 전자공학회논문지-TC 電子工學會論文誌 TC編 第44卷 第1號
발행연도
2007.1
수록면
62 - 68 (7page)

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디지털 멀티미디어 방송 (DMB)에 사용되는 영상 압축 기법인 H.264는 기존 기법에 비해 매우 높은 압축률을 보이지만 요구되는 하드웨어 크기 및 전력 소모도 기존 기법의 3~5배에 달한다. 따라서 상업적인 디지털 멀티미디어 방송 단말기를 위해 서는 하드웨어 크기 및 전력 소모를 크게 줄인 H.264 복호기 SoC가 필수적이다. 본 논문에서는 H.264 복호기 SoC를 구성하는 주요 블록의 저전력 설계 및 구현에 대해 논한다.
#디지털 멀티미디어 방송 #H.264 #저전력 #SoC

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 가변 길이 복호기 설계
Ⅲ. 인트라 예측기 설계
Ⅳ. 움직임 보상기 설계
Ⅴ. 결론
참고문헌
저자소개

참고문헌 (4)

참고문헌 신청
, 2003.5. , Draft ITU-T Recommen- dation and Final Draft International Standard of Joint Video Specification, google schola , 1995. , Low Power Digital CMOS Design google schola , 200 , H.264 and MPEG-4 Video Compression, Video Coding for Next-Generation Multimedia google schola , 2005..3. , Analysis, Fast Algorithm, and VLSI Architecture Design for H.264, AVC Intra Frame Coder 13 (3) google schola

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