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논문 기본 정보

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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編 第44卷 第7號
발행연도
2007.7
수록면
81 - 89 (9page)

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비터비 복호기는 디지털 통신 시스템에서 순방향 오류 정정을 위해서 사용하는 핵심적인 부분으로 최우 추정 복호 방식의 알고리즘을 사용한다. 비터비 복호기는 복호기 상태의 개수만큼의 경로를 계산하고 역 추적하는 특성 때문에 저 전력화가 상당히 어렵다. 본 논문에서는 기존의 SPEC-T 알고리즘을 구현하는데 있어서 비교기의 동작을 최소화할 수 있는 효율적인 방법을 제안하고 ACS(Add-Compare-Select) 구조와 MPMS(Minimum Path Metric Search) 구조에 이를 적용하였다. 실험 결과, 제안한 ACS 구조와 MPMS 구조는 기존의 구조보다 전력 소모량이 임계 값 26에서 각각 최대 약 10.7%와 11.5% 감소하였고 SPEC-T 구조보다는 전력 소모량이 임계 값 26에서 각각 약 6%와 1.5% 더 감소하였다.
#VLSI design #Viterbi decoder #low-power #SPEC-T algorithm

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 기본 정리
Ⅲ. 저 전력을 위한 비터비 복호기의 구조
Ⅳ. 실험 결과
Ⅴ. 결론
참고문헌
저자소개

참고문헌 (10)

참고문헌 신청
1. [학술지(정기간행물)] - / 1998 / Low-power Viterbi decoder for CDMA mobile terminals 33 : 473 ~ 482 google schola 2. [학술지(정기간행물)] - / / Low Power ACS Unit Design for the Viterbi Decoder 99 google schola 3. [학술지(정기간행물)] - / 2000 / Low power units for the Viterbi decoder : 412 ~ 415 google schola 4. [학술지(정기간행물)] - / 1998 / Improved Architectures for the Add-Compare-Select Operation in Long Constraint Length Viterbi Decoding 33 (1) google schola 5. [학술지(정기간행물)] - / 1988. / A Bit-Serial Architecture for a VLSI Viterbi Processor Conference Proc (7277) google schola

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