병렬 지수승에서 라운드 수 축소를 위한 알고리즘

김윤정

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자료유형: 학술저널

저자정보: 김윤정

저널정보: 한국정보보호학회 정보보호학회논문지 情報保護學會論文誌 Vol.14 No.1

발행연도: 2004.2

수록면: 113 - 119 (7page)

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지수승(exponentiation) 연산은 암호 관련 응용에서 널리 사용되고 있으며, 안전성을 위해 지수 n의 값을 크게 설정하여 이용하고 있다. 그런데, n의 값이 커짐에 따라 수행해야 하는 곱셈의 횟수도 따라서 증가하게 되고, 결과적으로 속도가 빠른 연산 알고리즘의 개발이 중요한 문제로 대두되고 있다. 본 논문에서는 정규 기저 표현(normal bases representation)을 갖는 GF(2 ⁿ) 상의 병렬 지수승 연산에 있어서, 프로세서 수가 고정된 경우에 라운드 수를 개선할 수 있는 알고리즘을 제안하고 이의 성능분석을 수행한다. 제안하는 방안은 지수(exponent)를 특정 비트 수로 나누어 지수승을 수행하는 윈도우 방법(window method)를 이용하는 것으로, 윈도우 값 계산 단계에서 휴지 프로세서들로 하여금 윈도우들 간의 곱을 계산하도록 함으로써, 전체 라운드 수를 줄이는 효과를 갖는다.

#exponentiation #GF(2²) #round bound #cryptography

참고문헌 (9)

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[학술지(정기간행물)] - / / Efficient Parallel Exponentiation in GF using Normal Basis Representations

[학술지(정기간행물)] - / 1988. / Fast exponentiation in GF 330 : 251 ~ 255

[학술지(정기간행물)] - / 1990. / Some Observations on parallel algorithms for fast exponentiation in GF 19 (4) : 711 ~ 717

[학술지(정기간행물)] - / 1991. / Joachim von zur Gathen Processor- efficient exponentiation in finite fields 1 : 360 ~ 394

[학술지(정기간행물)] - / 1992. / Joachim von zur Gathen Processor- efficient exponentiation in finite fields 41 : 81 ~ 86

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