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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編 第45卷 第6號
발행연도
2008.6
수록면
80 - 88 (9page)

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이 논문의 연구 히스토리 (2)

2008

스마트카드 적용을 위한 저전력 통합 암호화 엔진의 설계
김용희 ,  정용진 전자공학회논문지-SD 2008.06 학술저널

2007

스마트카드 적용을 위한 저전력 통합 암호화 모듈의 구현
김용희 ,  정용진 대한전자공학회 학술대회 2007.11 학술대회자료

초록· 키워드

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본 논문에서는 스마트카드 적용을 위하여 국내외 블록 암호화 표준 알고리즘인 3-DES(Triple Data Encryption Standard), AES(Advanced Encryption Standard), SEED, HASH(SHA-1)를 통합한 저전력 암호화 엔진을 하드웨어로 구현하였다. 휴대용 기기에 필수적인 작은 면적과 저전력을 위하여 하나의 라운드에 대한 각각의 암호화 블록을 구현한 후 반복동작을 하도록 설계하였고 두 단계의 클록 게이팅 기술을 적용하였다. 설계한 통합 암호화 엔진은 ALTERA Excalibur EPXA10F1020C2를 사용하여 검증하였고 합성결과 7,729 LEs와 512 바이트 ROM을 사용하여 최대 24.83 ㎒ 속도로 동작이 가능하였다. 삼성 0.18 um STD130 CMOS 스탠다드 셀 라이브러리로 합성한 결과 44,452 게이트를 사용하며 최대 50 ㎒의 속도로 동작이 가능하였다. 또한 전력소모를 측정한 결과 25 ㎒의 속도로 동작할 경우 3-DES, AES, SEED, SHA-1 모드일 때 각각 2.96 ㎽, 3.03 ㎽, 2.63 ㎽, 7.06 ㎽의 전력소모를 할 것으로 예측되었다. 이러한 저전력 통합 암호화 엔진은 스마트카드 적용에 가장 적합한 구조를 갖고 있으며 그 외에도 다양한 암호화 시스템에 적용될 수 있을 것으로 판단된다.
#low power #small area #smart card #clock gating #cryptography

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 블록 암호화 알고리즘 및 운영 모드
Ⅲ. 하드웨어 구조 및 설계
Ⅳ. FPGA 검증
Ⅴ. ASIC 합성 결과 및 분석
Ⅵ. 결론
참고문헌
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