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In a power system, an out-of-step condition causes a variety of risk such as serious damage to system elements, tripping of loads and generators, mal-operation of relays, etc. Therefore, it is very important to detect the out-of-step condition and take a proper measure. This paper presents a study on implementation of out-of-step detection algorithm using VHDL(Very high speed Hardware Description Language). The structure of out-of-step detection algorithm is analyzed for development of out-of-step detection relay on the FPGA(Field Programmable Gate Array). The out-of-step algorithm is separated to 4 parts: DFT IF, complex power calculation IP, out-of-step detection IP, control unit. Each parts are developed and simulated by using VHDL.
목차
Abstract
1. 서론
2. 동기탈조 검출 알고리즘의 하드웨어 구조
3. 동기탈조 검출 계전기의 VHDL 구현
4. 결론
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[학술지(정기간행물)] - Feng Tao / oct.2001. / A FPGA-based Implementation of Data Acquisition and Processing for Digital Protective Relays 23-25 : 518 ~ 521
[학술지(정기간행물)] - M.A. Manzoul / 1998. / Multi-function protective relay on FPGA 38 : 1963 ~ 1968
[학술지(정기간행물)] - M.A. Manzoul, / 1995. / OVERCURRENT RELAY ON A FPGA CHIP 35 (7) : 1017 ~ 1022
[학술지(정기간행물)] - 서종완 / 2000. / 디지털 보호계전기를 위한 ASIC 설계
[학술지(정기간행물)] - 권오상 / May,2005. / 복소전력의 변화율을 이용한 동기탈조 검출 알고리즘에 관한 연구-Part II 복소전력의 궤적 변화를 이용한 동기탈조 검출 알고리즘 54a (5) : 217 ~ 225
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