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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- 대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.9 No.4
- 발행연도
- 2009.12
- 수록면
- 187 - 191 (5page)
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This paper proposes a high-performance architecture of the H.264 intra prediction circuit. The proposed architecture uses the 4-input and 2-input common computation units and common registers for fast and efficient prediction operations. It avoids excessive power consumption by the efficient control of the external and internal memories. The implemented circuit based on the proposed architecture can process more than 60 HD (1,920x1,088) image frames per second at the maximum operating frequency of 101 ㎒ by using 130 nm standard cell library.
목차
Abstract
Ⅰ. INTRODUCTION
Ⅱ. PROPOSED ARCHITECTURE
Ⅲ. EXPERIMENTAL RESULTS
Ⅳ. CONCLUSIONS
ACKNOWLEDGMENTS
REFERENCES
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