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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2007.8
- 수록면
- 186 - 189 (4page)
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Generating round key fast in AES algorithm supporting three key sizes, such as 128, 192, and 256-bit keys is a critical factor to develop high throughput AES processors. In this paper, we propose on-the-fly round key generator which can be applied to the pipelined and non-pipelined AES processor that both encryption and decryption modes must be implemented on a chip. The proposed round key generator has modular and area-and-time efficient structure which consists of two key expanders, such as key_exp_m and key_exp_s modules. The round key generator for non-pipelined AES processor with three key sizes and encryption/decryption modes has about 8-ns delay time under 0.25㎛ 2.5V CMOS standard cell library and consists of a bout 17,700 gates.
목차
Abstract
Ⅰ. INTRODUCTION
Ⅱ. STANDARD ROUND KEY GENERATOR ALGORITHM
Ⅲ. ROUND KEY GENERATOR FOR PIPELINED AES PROCESSOR
Ⅳ. PERFORMANCE EVALUATIONS
Ⅴ. CONCLUSIONS
ACKNOWLEDGEMENTS
REFERENCES
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