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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2011.4
- 수록면
- 32 - 38 (7page)
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IEEE802.15.4 체계의 USN 센서노드 무선통신부에 내장하기 위한 5.0㎓ 광대역 RF 주파수 합성기를 0.18㎛ 실리콘 CMOS 기술을 이용하여 제작하였다. 고속 저잡음 특성을 얻기 위하여 VCO, 프리스케일러, 1/N 분주기, Σ-Δ 모듈레이터 분수형 분주기, PLL 공통 회로 등의 설계 최적화에 중점을 두고 설계하였으며, 특히 VCO는 N-P MOS 코어 구조 및 12단 캡 뱅크를 적용하여 고속 및 광대역 튜닝 범위를 동시에 확보하였다. 설계된 칩의 크기는 1.1*0.7㎟이며, IP로 활용하기 위한 코어부분의 크기는 1.0*0.4㎟이다. 주파수합성기를 제작한 다음 측을 통하여 분석해 본 결과 발진 범위 및 주파수 특성이 양호하게 나타났다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 센서노드의 구성
Ⅲ. 주파수합성기 회로의 설계
Ⅳ. 레이아웃 설계
Ⅵ. 측정 결과
Ⅶ. 결론
참고문헌
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