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저자정보
이동훈 (부산대학교) 류창원 (부산대학교) 남원석 (부산대학교) 박주성 (부산대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2007년도 SOC 학술대회
발행연도
2007.5
수록면
223 - 226 (4page)

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본 논문은 16-비트 고정 소수점 파이프라인 DSP 설계 및 구현을 다루고 있다. 제안된 DSP는 211개의 명령어와 6단 파이프라인을 갖추고 있으며, MAU, 40-비트 베럴 쉬프터, 40-비트 누산기 및 내부램 등의 기능 블록을 포함하고 있다. RTL code는 verilog HDL을 사용하였으며 69,860 게이트 규모를 가진다. 시뮬레이션 검증은 상용 시뮬레이터의 결과를 비교하며 수행하였으며, 개별 명령어 및 MP3 decoder, ADPCM vocoder 알고리즘을 통하여 호환성을 검증하였다. 또한 0.25um CMOS 공정으로 칩을 제작하여 PCB를 제작하여 l06MHz 클럭 하에 검증하여 정상적으로 동작됨을 확인하였다.
#DSP #pipeline #fixed-point #design #implementation

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅳ. 결론
참고문헌

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