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저자정보
Won-young Chung (연세대학교) Yeo-phil Yoon (연세대학교) Yong-surk Lee (연세대학교)
저널정보
대한전자공학회 ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications ITC-CSCC : 2008
발행연도
2008.7
수록면
1,161 - 1,164 (4page)

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In this paper, we propose a new instruction set for a network ASIP(Application Specific Instruction-set Processor). The new instruction set was designed for the packet processing engine on a network router. The network ASIP to accelerate the packet processing operation was built on a baseline ASIP, which is based on the general RISC structure. The new instruction set is divided into two groups. They are operated on each of its functional unit within the execution stage. After the derivation of the HDLmodel from LISA, the functional units were replaced by a hand-written Verilog-HDL.

목차

Abstract
1. Introduction
2. ASIP Design Flow
3. Experiment and Result
4. Conclusion
7. Acknowledgments
References

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