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이용수
Abstract
I. NTRODUCTION
II. ARCHITCTURE
III. CIRCUIT DESIGN
IV. EXPERIMENTAL RESULTS
V. CONCLUSION
ACKNOWLEDGEMENT
REFERENCES
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A 5-Gb/s Half-Rate Clock Recovery Circuit
대한전자공학회 ISOCC
2006 .10
A 5-Gb/s Half-rate Clock Recovery Circuit in 0.25-μm CMOS Technology
대한전자공학회 ISOCC
2006 .10
Analysis of a Data Recovery Circuit with Digital Oversampling Technique
Journal of Electrical Engineering and information Science
1998 .10
3.125Gbps Reference-less Clock and Data Recovery using 4X Oversampling
대한전자공학회 학술대회
2005 .05
3.125Gbps Reference-less Clock and Data Recovery using 4X Oversampling
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2005 .07
Analysis of a Data Recovery Circuit with Digital Oversampling Technique
Journal of Electrical Engineering and Information Science
1998 .10
Design and Implementation of Open-Loop Clock Recovery Circuit for 39.8 Gb/s and 42.8 Gb/s Dual-Mode Operation
[ETRI] ETRI Journal
2008 .04
A 1.25-Gb/s Clock and Data Recovery Circuit for Multichannel Application
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2005 .10
40 Gb/s 클럭 추출 회로 설계
한국통신학회 학술대회논문집
2002 .11
2X-Oversampling 2.5Gbps Clock and Data Recovery with Phase Picking Method
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2003 .07
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ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
1998 .01
2.5 Gb/s 클럭 및 데이터 복원 회로의 설계
대한전기학회 학술대회 논문집
2002 .11
2.5 Gb/s 클럭 및 데이터 복원 회로의 설계
대한전기학회 학술대회 논문집
2002 .11
100Mb/s~3Gb/s 전디지털 클록 데이터 복원회로 설계
대한전자공학회 학술대회
2012 .11
A 0.18-μm CMOS, 10-Gb/s Injection-Locked Clock and Data Recovery Circuit
대한전자공학회 ISOCC
2007 .10
고속 PLL을 위한 이중구조 PFD
전자공학회논문지-IE
2002 .03
1Gb/s gated-oscillator burst mode CDR for half-rate clock recovery
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2004 .12
A 40 Gb/s Clock and Data Recovery Module with Improved Phase-Locked Loop Circuits
[ETRI] ETRI Journal
2008 .04
Design and Characterization of a 10 Gb/s Clock and Data Recovery Circuit Implemented with Phase-Locked Loop
[ETRI] ETRI Journal
1999 .06
1.5Gb/s~6Gb/s 클록 주파수 체배기를 사용한 광대역 클록 및 데이터 복원 회로
대한전자공학회 학술대회
2013 .07
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