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논문 기본 정보

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학술저널
저자정보
Kyung-Wook Shin (금오공과대학교) Hae-Ju Kim (실리콘웍스)
저널정보
대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.12 No.1
발행연도
2012.3
수록면
24 - 33 (10page)

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이 논문의 연구 히스토리 (2)

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This paper describes a multi-mode LDPC decoder which supports 19 block lengths and 6 code rates of Quasi-Cyclic LDPC code for Mobile WiMAX system. To achieve an efficient implementation of 114 operation modes, some design optimizations are considered including block-serial layered decoding scheme, a memory reduction technique based on the min-sum decoding algorithm and a novel method for generating the cyclic shift values of parity check matrix. From fixed-point simulations, decoding performance and optimal hardware parameters are analyzed. The designed LDPC decoder is verified by FPGA implementation, and synthesized with a 0.18-㎛ CMOS cell library. It has 380,000 gates and 52,992 bits RAM, and the estimated throughput is about 164 ~ 222 Mbps at 56 ㎒@1.8 V

목차

Abstract
Ⅰ. INTRODUCTION
Ⅱ. LDPC CODES AND DECODING ALGORITHMS
Ⅲ. LDPC DECODER ARCHITECTURE
Ⅳ. IMPLEMENTATION RESULTS
Ⅴ. CONCLUSIONS
ACKNOWLEDGMENTS
REFERENCES

참고문헌 (19)

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