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논문 기본 정보

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학술저널
저자정보
이종석 (숭실대학교) 문용 (숭실대학교)
저널정보
대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 第49卷 SD編 第7號
발행연도
2012.7
수록면
23 - 29 (7page)

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디지털 PLL의 핵심블록이 되는 디지털 제어 발진기를 LC 구조를 기반으로 설계하고 0.18㎛ RF CMOS 공정을 사용하여 제작하였다. 2개의 교차쌍 구조의 NMOS 코어를 이용하여 광대역 특성을 구현하였으며, PMOS 배랙터쌍을 이용하여 수 aF의 작은 캐패시터값의 변화를 얻을 수 있었다. 캐패시터 축퇴 기법을 사용하여 캐패시턴스 값을 감소시키어 고해상도 주파수 특성을 구현하였다. 또한, 노이즈 필터링 기법을 바이어스 회로 등에 적용하여 위상잡음에 강한 구조로 설계를 하였다. 측정결과 중심주파수 2.7㎓에서 2.5㎓의 주파수 대역의 출력이 가능하였으며 2.9 ～ 7.1㎑의 높은 주파수해상도를 얻을 수 있었다. 미세 튜닝범위와 코어의 전류 바이어스는 4개의 PMOS 배열을 통하여 제어가 가능하도록 하여 유연성을 높였다. 1.8V 전원에서 전류는 17～26㎃ 정도를 소모하였다. 설계한 DCO는 다양한 통신시스템에 응용이 가능하다.
#PLL(Phase Locked Loop) #ADPLL(All Digital PLL) #DCO(Digitally Controlled Oscillator) #Varactor #phase noise #biasing

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. DCO 구조 및 설계
Ⅲ. 측정결과
Ⅳ. 결론
참고문헌
저자소개

참고문헌 (8)

참고문헌 신청
1. [학술대회논문] - I. Young / 1992 / A PLL clock generator with 5 to 110㎒ lock range for microprocessors / in IEEE Int. Solid-State Circuits Conf. Dig. Tech. Papers : 50 ~ 51 google schola 2. [학술대회논문] - 임경원 / 2011 / 압제어 선형항을 이용한 ㎓ 역 셀룰러 가변 발진기 네트웨크 회로 설계 / 2011년 SoC 학술회 : 327 ~ 330 google schola 3. [학술지(정기간행물)] - 부영건 / 2011 / 능동 인덕터를 이용한 광대역 디지털 제어 발진기의 설계 / 전자공학회논문지 - SD 48 (3) : 34 ~ 41 dbpia 4. [학술대회논문] - A. V. Rylyakov / 2007 / A Wide Power-Supply Range (0.5V-to-1.3V) Wide Tuning Range(500㎒-to-8㎓) All-Static CMOS AD PLL in 65㎚ SOI / IEEE Int. Solid-State Circuits Conf. Dig. Tech. Papers : 172 ~ 173 google schola 5. [학술대회논문] - Y. Chen / 2007 / A 9㎓ Dual-Mode Digitally Controlled Oscillator for GSM/UMTS Transceivers in 65㎚ CMOS / IEEE Asian Solid-State Circuit Conference 2007 google schola

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