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논문 기본 정보

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저널정보
대한전자공학회 전자공학회논문지 전자공학회논문지 제49권 9호
발행연도
2012.9
수록면
183 - 195 (13page)

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본 논문에서는 동일한 크기의 지수를 갖는 십진 부동소수점 오퍼랜드의 가산 및 감산연산을 빠르게 하기 위해, 두 개의 데이터 경로를 가지는 십진 부동소수점 가산기를 제안한다. 제안된 십진 부동소수점 가산기는 L. K. Wang의 오퍼랜드 정렬 계획을 사용하지만 오퍼랜드의 지수 크기가 같을 경우 정밀도를 보장하는 범위 내에서 속도 향상을 위해 고속의 데이터 경로를 통해 연산한다. 제안된 가산기의 성능 평가를 위해 Design Compiler에서 SMIC사의 0.18㎛ CMOS 공정 테크놀로지 라이브러리를 이용하여 합성하였다. 합성 결과 면적은 L. K. Wang의 가산기와 비교하여 8.26% 증가하였지만 전체 임계경로의 지연시간이 10.54% 감소하였다. 또한 같은 크기의 지수를 가지는 오퍼랜드를 연산할 때는 임계경로보다 13.65% 단축된 경로에서 연산을 수행하는 것을 확인하였다. 제안한 십진 부동소수점 가산기 구조는 동일 크기의 지수를 가지는 오퍼랜드의 비중이 2%이상일 때 L. K. Wang의 가산기 구조 대비 효용성이 높다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 십진 부동 소수점
Ⅲ. L. K. Wang의 십진 부동소수점 가산기
Ⅳ. 제안한 십진 부동소수점 가산기
Ⅴ. 실험
Ⅵ. 결론
참고문헌

참고문헌 (17)

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