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논문 기본 정보

자료유형
학술저널
저자정보
휸 하이 아우 김소영 (성균관대학교)
저널정보
대한전자공학회 전자공학회논문지 전자공학회논문지 제49권 11호
발행연도
2012.11
수록면
141 - 148 (8page)

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Oversampling 기법을 사용한 analog-to-digital (A/D) 컨버터에서 샘플링 된 신호의 signal bandwidth를 낮추어 주기 위해 데시메이션 필터가 사용된다. 본 논문은 sigma-delta ADC에 사용될 수 있는 저전력 4 단 32 bit 데시메이터 필터 디자인을 제안한다. 디지털 데시메이션 필터는 CIC(cascaded integrator-comb) filter와 세 개의 half-band FIR filter로 이루어져 있다. 전력소모를 최소화하기 위하여 CIC filter에는 pipeline구조가 사용되었고, FIR 필터의 multiplier 구조를 최적화하기 위하여 Canonic Signed Digit (CSD) 코드가 사용되었다. 130nm CMOS 공정으로 설계 자동화 CAD 도구를 사용하여 타이밍, 면적, 전력소모를 최적화하여 98.304 ㎒ 주파수에서 697 ㎼의 전력을 소모면서 32 bit, 192 ㎑ 아웃풋을 낼 수 있다.

목차

요약
Abstract
Ⅰ. Introduction
Ⅱ. Proposed Decimation Filter Design
Ⅲ. Logical and Physical Implementation
Ⅳ. Experimental Results
Ⅴ. Conclusion
References

참고문헌 (10)

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