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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2012.11
- 수록면
- 2,151 - 2,154 (4page)
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본 논문은 나로과학위성 탑재컴퓨터의 설계 및 개발에 대해 기술하였다. LEON3 프로세서를 사용하는 나로과학위성 탑재컴퓨터는 FPGA 상에서 동작하며, 우주 방사능 환경으로 발생하는 SEU로 인한 영향을 줄이기 위하여 Triple Modular Redundancy (TMR) 기법을 사용하였다. TMR 기법은 널리 알려진 에러감쇄 기법 중 하나로 다중화에 기반한 기법이다. 실험 결과를 통해 TMR 기법을 적용하지 않은 경우와 TMR 기법을 적용한 경우 FPGA의 자원 사용률의 변화를 확인하였다. TMR 기법을 적용하였을 경우 LUT와 F/F 사용률이 각각 약 3.5배, 약 3배 정도 증가함을 보였다. 최대 동작 클럭 속도 또한 약 7%정도 감소함을 확인하였다.
목차
초록
ABSTRACT
1. 서론
2. 나로과학위성 탑재컴퓨터
3. SEU 감소 기법 적용
4. 실험 결과
5. 결론
참고문헌
참고문헌 (0)
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