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학술저널
저자정보
Shin-Il Lim (Seokyeong University) Jin Woo Kim (Seokyeong University) Kwang-Sub Yoon (Inha University) Sangmin Lee (Inha University)
저널정보
대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.13 No.2
발행연도
2013.4
수록면
108 - 113 (6page)

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This paper describes a low power asynchronous successive approximation register (SAR) type 12b analog-to-digital converter (ADC) for biomedical applications in a 0.35 μm CMOS technology. The digital-to-analog converter (DAC) uses a capacitive split-arrays consisting of 6-b main array, an attenuation capacitor C and a 5-b sub array for low power consumption and small die area. Moreover, splitting the MSB capacitor into subcapacitors and an asynchronous SAR reduce power consumption. The measurement results show that the proposed ADC achieved the SNDR of 68.32 dB, the SFDR of 79 dB, and the ENOB (effective number of bits) of 11.05 bits. The measured INL and DNL were 1.9LSB and 1.5LSB, respectively. The power consumption including all the digital circuits is 6.7 μW at the sampling frequency of 100 KHz under 3.3 V supply voltage and the FoM (figure of merit) is 49 fJ/conversion-step.
#SAR type ADC #biomedical #splitcapacitor array #asynchronous control

목차

Abstract
I. INTRODUCTION
II. ARCHITECTURE OF THE PROPOSED DAC
III. ASYNCHRONOUS CONTROL AND COMPARATOR
IV. MEASUREMENT RESULTS
V. CONCLUSIONS
REFERENCES

참고문헌 (7)

참고문헌 신청
1. [학술대회논문] - B. P. Ginsburg / 2005 / An Energy-Efficient Charge Recycling Approach for a SAR Converter With Capacitive DAC / Proc. IEEE Int. Sym. Circuits and System 1 : 184 ~ 187 google schola 2. [학술지(정기간행물)] - Michael D. Scott / 2003 / An Ultralow-Energy ADC for Smart Dust / IEEE J. Solid-state Circuits 38 : 1123 ~ 1129 google schola 3. [학술대회논문] - Pieter Harpe / 2010 / A 30fJ/Conversion-Step 8b 0-to-10 MS/s Asynchronous SAR ADC in 90nm CMOS / ISSCC Dig. Tech Papers : 387 ~ 389 google schola 4. [학술지(정기간행물)] - Peng Zhu Yan / 2010 / A 10-bit 100-MS/s Reference-Free SAR ADC in 90nm CMOS / IEEE Journal of Solid-state circuits : 1111 ~ 1121 google schola 5. [학술대회논문] - Sin Sai-Weng / 2010 / An 11b 60MS/s 2.1mW two-step time-interleaved SAR-ADC with reused S&H / ESSCIRC : 218 ~ 221 google schola

이 논문의 저자 정보

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