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논문 기본 정보

자료유형
학술저널
저자정보
김한슬 (청주대학교) 손상희 (청주대학교)
저널정보
한국정보기술학회 한국정보기술학회논문지 한국정보기술학회논문지 제11권 제5호(JKIIT, Vol.11, No.5)
발행연도
2013.5
수록면
39 - 44 (6page)
DOI
10.14801/kiitr.2013.11.5.39

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본 논문에서는 기존에 사용되던 auto-zeroing 방식의 옵셋 전압 저감회로가 가지는 단점을 보완하면서 고주파대역에서 연산증폭기 옵셋 전압을 더 효과적으로 저감시킬 수 있는 새로운 회로구조를 제안하였다. 제안하는 회로구조는 기존의 auto-zeroing 방식의 구조에 커패시터와 일부 스위치를 추가한 듀얼커패시터 구조로서 비교적 간단하며 구현가능성이 높은 구조이다, 또한 안정적인 출력파형을 발생할 수 있다. 제안한 회로의 동작은 TSMC 1.8V, 0.18㎛ CMOS 공정을 이용하여 Hspice 회로 시뮬레이션을 통해 검증하였다. 시뮬레이션 결과, 제안한 방식의 회로를 1GHz의 동작주파수에서 30mV의 옵셋전압을 발생시키는 연산증폭기에 적용하였을때, 1mV 이하의 옵셋 전압으로 저감되어 발생됨을 확인할 수 있었고, 이를 통해 기존의 auto-zeroing 옵셋 저감 방식과 비교했을 때 옵셋 전압이 매우 효과적으로 감소한 것을 확인할 수 있었다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 듀얼 커패시터를 사용한 새로운옵셋 저감회로 제안
Ⅲ. 모의 실험 결과
Ⅳ. 결론
참고문헌

참고문헌 (8)

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