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논문 기본 정보

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학술저널
저자정보
김동현 (금오공과대학교) 신경욱 (금오공과대학교)
저널정보
한국정보통신학회 한국정보통신학회논문지 한국정보통신학회논문지 제16권 제11호
발행연도
2012.11
수록면
177 - 184 (8page)

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국가표준으로 제정된 블록암호 알고리듬 ARIA의 효율적인 하드웨어 구현에 대해 기술한다. 본 논문의 ARIA 암·복호 프로세서는 표준에 제시된 3가지 마스터 키 길이 128/192/256-비트와 ECB, CBC, OFB, CTR의 4가지 운영모드를 지원하도록 설계되었다. 키 확장 초기화 과정과 암·복호 과정에 사용되는 라운드 함수가 공유되도록 설계를 최적화 하였으며, 이를 통해 게이트 수를 약 20% 감소시켰다. 설계된 ARIA 암·복호 프로세서를 FPGA로 구현하여 하드웨어 동작을 검증하였으며, 0.13-㎛ CMOS 표준셀로 합성한 결과 46,100 게이트로 구현되었다. 레이아웃의 면적은 684-㎛ × 684-㎛ 이며, 200 MHz@1.2V로 동작하여 1.28 Gbps의 성능을 갖는 것으로 평가되었다.
#ARIA 알고리듬 #블록암호 #정보보안 #암호화 #암호 운영모드 #ARIA algorithm #block cipher #information security #encryption #modes of operation

목차

요약
ABSTRACT
Ⅰ. 서론
Ⅱ. ARIA 블록암호 알고리듬과 운영모드
Ⅲ. ARIA 암ㆍ복호 프로세서 설계
Ⅳ. 설계 검증, 레이아웃 설계 및 성능 평가
Ⅴ. 결론
참고문헌

참고문헌 (12)

참고문헌 신청
1. [단행본] - W. Stalling / 1999 / Cryptography and Network Security / Prentice Hall google schola 2. [인터넷자원] - 국가보안기술연구소 / / 민관겸용 블록 암호 알고리즘 ARIA 알고리듬 명세서 google schola 3. [인터넷자원] - 국가보안기술연구소 / / Security and Performance Analysis of ARIA google schola 4. [기타자료] - / / FIPS Publication197, Advanced Encryption Standard (AES) / U.S. Doc/NIST google schola 6. [학술지(정기간행물)] - 하성주 / 2008 / 블록 암호 ARIA를 위한 고속 암호기/복호기 설계 / 전기학회논문지ABCD 57 (9) : 1652 ~ 1659 dbpia

이 논문의 저자 정보

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