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논문 기본 정보

자료유형
학술저널
저자정보
기대욱 (부산대학교) 김재호 (부산대학교)
저널정보
한국정보통신학회 한국정보통신학회논문지 한국정보통신학회논문지 제14권 제3호
발행연도
2010.3
수록면
621 - 627 (7page)

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본 논문에서는 SVC 복호화기에서 각 계층간 Inter layer 업-샘플링을 효과적으로 구현하기 위한 하드웨어 구조를 제안한다. 제안하는 구조에서 수직, 수평 방향 업-샘플링을 위한register bank와 보간 모듈이 설계된다. 제안 구조를 사용하여 SRAM 메모리가 감소되고 JSVM과 비교해서 약 41%의 메모리 밴드위스가 감소되었다.

목차

요약
ABSTRACT
Ⅰ. 서론
Ⅱ. SVC의 계층간 화면내 예측방식
Ⅲ. 제안방식
Ⅳ. 실험결과
Ⅴ. 결론
참고문헌

참고문헌 (9)

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