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본 논문에서는 고속 PMIC(Power Management Integrated Circuit) 회로를 위한 저전압 입력 보호기능을 가지는 UVLO(Under Voltage Lock Out) 기능이 탑재된 LDO(Low Drop-Out) 레귤레이터를 설계하였다. 설계된 LDO 레귤레이터는 밴드갭 기준전압 회로, 오차 증폭회로, 파워 트랜지스터 등으로 이루어지진다. LDO 레귤레이터는 5 V 전원전압으로부터 3.3V 출력을 갖도록 설계되었으며, 저전압 입력보호 기능을 하는 UVLO 회로는 전원부와 파워 트랜지스터 사이에 삽입된다. 또한 UVLO는 5 V 구동전압에서, 하강 시 2.7 V 에서 LDO 레귤레이터 동작을 멈추게 하고, 구동전압 상승 시 4.0 V 에서 LDO 레귤레이터가 정상 동작한다. 1 ㎛ 20 V 고전압 CMOS 공정을 사용하여 모의실험 한 결과, 설계한 LDO 레귤레이터는 5.88 mV/V의 라인레귤레이션을 가지고, 부하전류가 0 mA에서 200 mA로 변할 때 27.5 uV/mA의 로드레귤레이션을 보였다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. UVLO 기능을 가지는 LDO 레귤레이터
Ⅲ. SPICE 모의실험 결과
Ⅳ. 결론
REFERENCES
참고문헌 (6)
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1. [학술대회논문] - M. Paavola / 2008 / A micropower low-dropout regulator with a programmable on-chip load capacitor for a low-power capacitive sensor interface / IEEE International Conference on Electronics, Circuits and Systems : 450 ~ 453
2. [학술지(정기간행물)] - Mohammad Al-Shyukh / 2007 / A Transient-Enhanced Low-Quiescent Current Low-Dropout Regulator With Buffer Impedance Attenuation / IEEE J. Solid Stage Circuit 42 (8) : 1732 ~ 1742
3. [학술지(정기간행물)] - Hoi Lee / 2005 / A design of low-power analog drivers based on slew-rate enhancement circuits for cmos low-dropout regulators / IEEE. J. Solid – State Circuit 52 (9) : 563 ~ 567
4. [학술지(정기간행물)] - Man Siu / 2006 / A voltage-mode pwm buck regulator with end-point prediction / IEEE TCAS II 53 (4) : 294 ~ 298
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5. [학술지(정기간행물)] - R. G. Carvajal / 2005 / The flipped voltage follower : a useful cell for low-voltage low-power circuit design / IEEE Trans. Circuits and Systems I 52 (7) : 1276 ~ 1291
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