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저자정보
김성모 (한국외국어대학교) 신재호 (한국외국어대학교) 김수진 (한국외국어대학교) 조경순 (한국외국어대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2013년도 대한전자공학회 추계종합학술대회
발행연도
2013.11
수록면
47 - 50 (4page)

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This paper describes the architecture and design of high-performance Haar-like feature extraction circuit for HD(High Definition) images. The proposed circuit extracts 10 Haar-like features at the same time for real-time processing out of 100 features per sliding window. We described the proposed circuit using Verilog HDL(Hardware Description Language) and synthesized the gate-level circuit using TSMC 180nm standard cell library. The resulting circuit consists of 842,459 logic gates, 32 64×63-bit single port SRAM"s(Static Random Access Memories) and 50×42-bit ROM(Read Only Memory). The maximum operating frequency is 105.9MHz. We also fabricated an MPW(Multi Project Wafer) chip for the integral image generation circuit requiring the most intensive computation in Haar-like feature extraction circuit.

목차

Abstract
Ⅰ. 서론
Ⅱ. Haar-like 특징 추출 기술
Ⅲ. 고성능 Haar-like 특징 추출 회로
Ⅳ. 실험결과
Ⅴ. 결론
참고문헌

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