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김경민 (고려대학교) 배상근 (고려대학교) 이연호 (고려대학교) 박세진 (고려대학교) 김가빈 (고려대학교) 김자영 (고려대학교) 김용태 (고려대학교) 최선명 (고려대학교) 김철우 (고려대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2014년도 대한전자공학회 하계종합학술대회
발행연도
2014.6
수록면
92 - 95 (4page)

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This paper proposes a fractional-N frequency synthesizer based on sub-sampling PLL(SSPLL). Despite of the low phase noise and the low jitter performance, it is difficult to make a fractional-N synthesizer based on SSPLL because of its dividerless characteristic. The proposed circuit enables the fractional-N synthesizer based on SSPLL using a flying adder structure. The synthesizer is implemented in a 65nm CMOS technology.

목차

Abstract
I. 서론
II. 본론
Ⅲ. 구현
Ⅳ. 결론 및 향후 연구 방향
참고문헌

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