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저자정보
이병석 (조선대학교) 이정근 (캠브리지대학교) 이정아 (조선대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 대한전자공학회 2006년도 추계학술대회 논문집Ⅱ
발행연도
2006.11
수록면
407 - 410 (4page)

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Many adder designs exists for a designer to choose the fastest or the smallest or power efficient one. However, the performance of existing adders varies widely in their speed and area requirements, which in tum sometimes makes designers pay a high cost in area especially when the delay requirements exceeds the fastest speed of a specific adder, no matter how small the difference it is. For the two optimization problems “area optimization under delay constraints” and “delay optimization under area constraints”, we formulate the optimization problems of determining the bit-width of various carry propagate sub-adders in Integer Linear Programming. We demonstrate the effectiveness of the new adder architecture using 128-bit adder design.

목차

Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 실험 및 결과
Ⅳ. 결론
참고문헌

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