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저자정보
이원표 (청주대학교) 김세호 (청주대학교) 윤달환 (청주대학교) 김희석 (청주대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 대한전자공학회 2006년도 추계학술대회 논문집Ⅱ
발행연도
2006.11
수록면
808 - 811 (4page)

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In this paper, we design UART using ODC computation that is one of methods for Clock Gating applicable at the register transfer level(RTL). The ODC computation Method is began at point that estimate the value considering Don’t Care Conditions from output of datapath to registers using elk in system. Using modified this value, we reduce consumption power due to controlling clock that was supplied at registers. In Experimental results, ODC computation Method reduce power reductions of around 30%.

목차

Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 구현
Ⅳ. 실험 결과
Ⅴ. 결론 및 향후 연구방향
참고문헌

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