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이용수
1995
Abstract
1. 서론
2. Segmentation
3. 디스크립터 캐쉬 동작 알고리즘
4. 디스크립터 캐쉬 아키텍쳐
5. 설계 방법
6. 전기적 특성
7. 결론
참고문헌
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1995 .11
수퍼스칼라 마이크로프로세서용 세그멘트 디스크립터 캐쉬 제어 유닛의 HDL 모델링
대한전자공학회 학술대회
1994 .11
수퍼스칼라 마이크로프로세서용 세그먼트 디스크립터 캐쉬 제어 유닛의 HDL 모델링 ( HDL modeling of a segment descriptor cache control unit for superscalar microprocessor )
대한전자공학회 학술대회
1994 .11
마이크로프로세서 캐쉬메모리의 성능개선
한국통신학회 학술대회논문집
1999 .07
마이크로프로세서 캐쉬메모리의 적중률 개선을 위한 제안 ( A Proposal for Hit Ratio Improvement of a Microprocessor's Cache Memory )
한국통신학회논문지
2000 .04
Mixed H₂/H∞ Controller Design for Descriptor Systems
전기학회논문지 D
2004 .07
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한국통신학회논문지
1995 .05
캐쉬 제어기 설계 ( Design of Cache Controller )
대한전자공학회 학술대회
1992 .07
캐쉬 제어기 설계
대한전자공학회 학술대회
1992 .06
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정보과학회논문지 : 컴퓨팅의 실제 및 레터
2011 .03
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대한전자공학회 기타 간행물
1992 .01
HDL Modeling of the Descriptor Cache unit for Superscalar Microprocessor
ICEIC : International Conference on Electronics, Informations and Communications
1995 .01
디지탈 시스템과 마이크로프로세서설계(Ⅰ)
전기의세계
1982 .07
HDL modeling of the descriptor cache unit for superscalar microprocessor
ICEIC : International Conference on Electronics, Informations and Communications
1995 .08
고성능 마이크로프로세서를 위한 클럭 발생 회로
대한전자공학회 학술대회
1997 .11
고성능 마이크로프로세서를 위한 클럭 발생 회로 ( Clock Generation Circuit for High-Performance Microprocessors )
대한전자공학회 학술대회
1997 .11
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정보과학회논문지 : 시스템 및 이론
2010 .10
디스크립터 시스템 기반 강인한 퍼지 제어기 설계
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2011 .12
수퍼스칼라 마이크로프로세서 데이터 캐쉬 제어기 HDL 모델링 ( HDL Modeling of a Data Cache Controller for Superscalar Microprocessor )
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1994 .01
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