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대한전자공학회 대한전자공학회 학술대회 대한전자공학회 종합 학술 대회 논문집 (추계) 1998 Vol.21 No.2
발행연도
1998.11
수록면
1,025 - 1,028 (4page)

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이 논문의 연구 히스토리 (4)

1998

부동소수점 라운딩 병렬화 알고리즘의 하드웨어 구현을 위한 구조 설계
이원희 ,  강준우 대한전자공학회 학술대회 1998.11 학술대회자료
부동소수점 덧셈과 곱셈에서의 라운딩 병렬화 알고리즘 연구
이원희 ,  강준우 대한전자공학회 학술대회 1998.11 학술대회자료
부동소수점 라운딩 병렬화 알고리즘의 하드웨어 구현을 위한 구조 설계 ( Architectural Design for Hardware Implementations of Parallelized Floating-point Rounding Algorithm )
이원희 ,  강준우 대한전자공학회 학술대회 1998.11 학술대회자료
부동소수점 덧셈과 곱셈에서의 라운딩 병렬화 알고리즘 연구 ( Study on Parallelized Rounding Algorithm in Floating-point Addition and Multiplication )
이원희 ,  강준우 대한전자공학회 학술대회 1998.11 학술대회자료

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목차

Abstract
Ⅰ. 서론
Ⅱ. 라운딩 병렬화 알고리즘
Ⅲ. 덧셈 모듈의 구조
Ⅳ. 곱셈 모듈의 구조
Ⅴ. 결론
참고문헌

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