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이용수
요약
Ⅰ. 서론
Ⅱ. 2원 BCH 부호의 구조 및 복호 알고리듬
Ⅲ. 2원 BCH 부호의 고속 복호기 설계
Ⅳ. 실험 결과
Ⅴ. 결론
참고문헌
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2원 BCH 부호를 위한 고속 복호기의 VHDL 모델링 ( VHDL Modeling of High Speed Decoder for Binary BCH Codes )
대한전자공학회 학술대회
1997 .11
5중 오류정정 (255, 215) BCH 부호의 효율적인 복호 알고리즘과 이의 VHDL 시뮬레이션
정보보호학회논문지
1997 .03
5중 오류정정 (255, 215) BCH 부호의 효율적인 복호 알고리듬과 이의 VHDL 시뮬레이션
대한전자공학회 학술대회
1996 .11
5중 오류정정 ( 255 , 215 ) BCH 부호의 효율적인 복호 알고리듬과 이의 VHDL 시뮬레이션 ( Efficient Decoding Algorithm of 5-Error-Correcting ( 255 , 215 ) BCH Code and Its VHDL Simulation )
대한전자공학회 학술대회
1996 .11
2원 BCH 부호의 무지연 복호기 구성 ( The Construction of the Line-Speed Decoder for the Binary BCH Codes )
대한전자공학회 학술대회
1984 .01
VHDL을 이용한 2원 ( 31 , 21 ) BCH CODEC의 설계 ( Design of Binary ( 31 , 21 ) BCH CODEC Using VHDL )
대한전자공학회 학술대회
1997 .01
( 255 , 239 ) BCH 복호기 설계 ( The Design of ( 255 , 239 ) BCH Decoder )
대한전자공학회 학술대회
1984 .01
2원 BCH부호의 직접복호법 ( A Direct Decoding Method for Binary BCH Codes )
한국통신학회논문지
1989 .02
확장된 BCH 부호의 복호에 관한 연구 ( On the Decoding of Extended BCH Codes )
대한전자공학회 학술대회
1987 .11
( 31 , 16 ) BCH 부호의 복호기 설계 ( The Design of ( 31 , 16 ) BCH Codec )
대한전자공학회 학술대회
1983 .01
2元 BCH符號의 無遲延復號器 構成
대한전자공학회 학술대회
1984 .11
직접복호법을 이용한 (255, 239) BCH 부호의 복호기
대한전기학회 학술대회 논문집
1988 .07
직접복호법을 이용한 ( 225 , 239 ) BCH부호의 복호기 ( Hardware Implementation of ( 255 , 239 ) BCH Decoder Using Direct Decoding Method )
대한전자공학회 학술대회
1988 .07
BCH and RS Codes
한국통신학회 단기강좌
1998 .01
Microprocessor를 사용한 BCH 부호의 복호기 ( Decoder of the BCH code using the microprocessor )
대한전자공학회 학술대회
1987 .11
3중 오류 정정 BCH부호의 병렬복호기 구현에 관한 연구 ( An Implementation of Parallel Decoder for TEC-BCH Codes )
대한전자공학회 학술대회
1988 .07
3중 오류정정 BCH부호의 병렬복호기 구현에 관한 연구
대한전기학회 학술대회 논문집
1988 .07
40Gb/s급 BCH(2040,1930) 복호기 구조
대한전자공학회 학술대회
2008 .05
( 127 , 113 ) BCH 부호기 및 복호기 장치화에 관한연구 ( A Study on the ( 127 , 113 ) BCH encoder / decoder Hardware implementation )
대한전자공학회 학술대회
1987 .11
대칭행렬을 이용한 2원 BCH 부호의 복호 ( The decoding method of Binary BCH Codes using symmetric matrix )
대한전자공학회 학술대회
1988 .11
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