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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2016.10
- 수록면
- 1,179 - 1,182 (4page)
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본 논문에서는 sine-linear phase difference 방식과 DPCM 방식의 차동 양자화 기술을 응용하여 새로운 ROM 압축방식을 제안하고 이를 이용하여 저전력 직접 디지털 주파수 합성기를 FPGA를 사용하여 설계 및 제작한다. ROM 크기를 줄이기 위해 사인파의 1/4주기를 2<SUP>N</SUP> 간격으로 표본화하여 양자화된 값을 양자화 ROM1에 저장하고 각 표본화 사이를 2<SUP>K</SUP> 간격으로 표본화하고 ROM1에 저장된 표본화 값의 차이를 ROM2에 저장하여 ROM의 크기를 줄이는 방식을 사용한다. 이를 사용함으로써 기존 방식 대비 약 37%의 ROM 크기만 필요하게 되여 전력 소모를 줄일 수 있다.
목차
요약
ABSTRACT
Ⅰ. 서론
Ⅱ. Sine-linear phase difference 방식의 차동 양자화 직접 디지털 주파수 합성기
Ⅲ. DDFS의 FPGA 설계 및 실험
Ⅳ. 결론
References
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