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논문 기본 정보

자료유형
학술저널
저자정보
Huyen Pham Thi (Inha University) Hanho Lee (Inha University)
저널정보
대한전자공학회 IEIE Transactions on Smart Processing & Computing IEIE Transactions on Smart Processing & Computing Vol.6 No.3
발행연도
2017.6
수록면
210 - 219 (10page)

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This paper proposes a modified min-max algorithm (MMMA) for nonbinary quasi-cyclic low-density parity-check (NB-QC-LDPC) codes and an efficient parallel block-layered decoder architecture corresponding to the algorithm on a graphics processing unit (GPU) platform. The algorithm removes multiplications over the Galois field (GF) in the merger step to reduce decoding latency without any performance loss. The decoding implementation on a GPU for NB-QC-LDPC codes achieves improvements in both flexibility and scalability. To perform the decoding on the GPU, data and memory structures suitable for parallel computing are designed. The implementation results for NB-QC-LDPC codes over GF(32) and GF(64) demonstrate that the parallel blocklayered decoding on a GPU accelerates the decoding process to provide a faster decoding runtime, and obtains a higher coding gain under a low 10-10 bit error rate and low 10-7 frame error rate, compared to existing methods.

목차

Abstract
1. Introduction
2. NB-LDPC Codes and Decoding Algorithms
3. Parallel Block-layered NB-QC-LDPC decoding on a GPU using CUDA
4. Experimental Results
5. Conclusions
References

참고문헌 (23)

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UCI(KEPA) : I410-ECN-0101-2018-569-000882976