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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 저널정보
- 한국정보통신학회 INTERNATIONAL CONFERENCE ON FUTURE INFORMATION & COMMUNICATION ENGINEERING 2015 INTERNATIONAL CONFERENCE ON FUTURE INFORMATION & COMMUNICATION ENGINEERING Vo.7 No.1
- 발행연도
- 2015.6
- 수록면
- 93 - 96 (4page)
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Recently, many studies on GP-GPU are being conducted to satisfy the requirements for enormous quantities of calculations and high processing speeds that are demanded by latest technologies in all industries. In the process of expanding the GP-GPU into multicore, the core scheduling has great effects on the performance of GP-GPU. In this paper, a Warp Scheduler is proposed for the improvement of a multi-core SIMT based GP-GPU. The proposed Warp Scheduler can simultaneously issue two warps by applying the dual-warp issue feature. Furthermore, it can simultaneously process up to four instructions because each warp can issue two instructions through superscalar issue. For scheduling algorithm, the round-robin algorithm was used. For the experimental environment, Xilinx’s VC-707 FPGA platform board was used. To measure the parallel calculation performance, the square matrix multiplication processing result of the GP-GPU using the proposed Warp Scheduler was compared with that of the multi-core CPU on various embedded platforms. The experiment results showed that the processing speed of the GPGPU using the Warp Scheduler was 6-7 times faster.
목차
Abstract
I. INTRODUCTION
II. PROPOSED WARP SCHEDULER
III. EXPERIMENT
IV. CONCLUSIONS
REFERENCES
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