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학술저널
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Jinho Han (Electronics and Telecommunications Research Institute) Youngsu Kwon (Electronics and Telecommunications Research Institute) Kyeongsun Shin (Electronics and Telecommunications Research Institute) Hoi-Jun Yoo (Korea Advanced Institute of Science and Technology)
저널정보
대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.17 No.5
발행연도
2017.10
수록면
627 - 635 (9page)
DOI
10.5573/JSTS.2017.17.5.627

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The processor is becoming increasingly susceptible to transient faults with fluctuating voltage, widening operating temperature, and increasing clock frequency. Especially, processor, operating near threshold voltage for a low power, can expose to transient faults with the thin margin of process, voltage, and temperature. This paper presents a fault tolerant processor having on-chip fault monitor systems for processor core and cache, which detects faults and corrects faults, and a fault injector which injects faults for testing. The fault tolerant feature is analyzed by a fault injection and quantitative analysis complying with ISO26262 standard. As a result, the proposed work achieves 80 μW/MHz energy efficiency, 850 MHz maximum frequency, 72% fault trap reduction, and 99.23% single point fault failure rate complying with ISO26262.
#Fault tolerant processor #fault monitor #ISO26262 #fault injection #near threshold voltage

목차

Abstract
I. INTRODUCTION
II. THE PROPOSED PROCESSOR ARCHITECTURE
III. FAULT TOLERANT FEATURE
IV. IMPLEMENTATION RESULTS
V. CONCLUSIONS
REFERENCES

참고문헌 (8)

참고문헌 신청
Shailendra Jain, SurhdKhare, Satish Yada, and et. Al. “A 280mV-to-1.2V Wide-Operating-Range IA- 32 Processor in 32nmCMO, ” the proceedings of International Solid State Circuits Conference, pp.66-67, 2012. E. Rotenberg, “AR-SMT: A Microarchitectural Approach to Fault Tolerance in Microprocessors”, in Proc. 29th Intl. Symp. On Fault-Tolerant Computing (FTCS’99), pp. 84-91. C. LaFrieda, et al., “Utilizing Dynamically Coupled Cores to Form a Resilient Chip Multiprocessor,” in Proc. 37th IEEE Intl. Conf. on Dependable Systems and Networks (DSN’07), pp. 317 - 326. U. Ramacher, et al., “A 53-GOPS Programmable Vision Processor For Processing, Coding-Decoding And Synthesizing Of Images,” in Proc. 27th European Solid-State Circuits Conf. (ESSCIRC’01), pp.133-136. Road vehicles ? Functional Safety, ISO26262, 2012.

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