CIOS 몽고메리 모듈러 곱셈 알고리즘 기반 Scalable RSA 공개키 암호 프로세서

조욱래; 신경욱

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자료유형: 학술저널

저자정보: 조욱래 (Kumoh National Institute of Technology) 신경욱 (Kumoh National Institute of Technology)

저널정보: 한국정보통신학회 한국정보통신학회논문지 한국정보통신학회논문지 제22권 제1호

발행연도: 2018.1

수록면: 100 - 108 (9page)

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512/1,024/2,048/3,072 비트의 4가지 키 길이를 지원하는 scalable RSA 공개키 암호 프로세서를 설계하였다. RSA 암호의 핵심 연산블록인 모듈러 곱셈기를 CIOS (Coarsely Integrated Operand Scanning) 몽고메리 모듈러 곱셈 알고리듬을 이용하여 32 비트 데이터 패스로 설계하였으며, 모듈러 지수승 연산은 Left-to-Right (L-R) 이진 멱승 알고리듬을 적용하여 구현하였다. 설계된 RSA 암호 프로세서를 Virtex-5 FPGA로 구현하여 하드웨어 동작을 검증하였으며, 512/1,024/2,048/3,072 비트의 키 길이에 대해 각각 456,051/3,496,347/26,011,947/88,112,770 클록 사이클이 소요된다. 0.18 ㎛ CMOS 표준셀 라이브러리를 사용하여 100 MHz 동작 주파수로 합성한 결과, 10,672 GE와 6×3,072 비트의 메모리로 구현되었다. 설계된 RSA 공개키 암호 프로세서는 최대 동작 주파수는 147 MHz로 예측되었으며, 키 길이에 따라 RSA 복호 연산에 3.1/23.8/177/599.4 ms 가 소요되는 것으로 평가되었다.

#RSA #공개키 암호 #몽고메리 모듈러 곱셈 알고리듬 #모듈러 곱셈기 #CIOS #RSA #public-key cryptography #Montgomery modular multiplication algorithm #modular multiplier #CIOS

참고문헌 (17)

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[인터넷자원] - Korea Internet & Security Agency (KISA) / / IoT Common Security Principle v1.0

[학술지(정기간행물)] - R. Rivest / 1978 / A method for obtaining Digital Signatures and Public-Key Cryptosystems / Communications of the ACM 21 (2) : 120 ~ 126

[기타자료] - / 2000 / NIST Std. FIPS PUB 186-2: Digital Signature Standard (DSS) / NIST

[학술대회논문] - J. Shao / 2013 / Design and implimentation of RSA for dual interface bank IC card / 2013 IEEE 10th International Conference on ASIC (ASICON) : 1 ~ 4

[학술지(정기간행물)] - 김무섭 / 2009 / Design of Cryptographic Hardware Architecture for Mobile Computing / JIPS(Journal of Information Processing Systems) 5 (4) : 187 ~ 196

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