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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- 대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.19 No.3
- 발행연도
- 2019.6
- 수록면
- 270 - 275 (6page)
- DOI
- 10.5573/JSTS.2019.19.3.270
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This paper proposes a 10-Gb/s output driver based on Current-Mode Logic (CML) driver with 2-tap including pre-emphasis and de-emphasis method by using reconfigurable capacitive peaking. The proposed is implemented in 55-nm CMOS process with 1.2 V supply. The proposed output driver can compensate for insertion loss -12.3 dB just with 2-tap and controlling the number of capacitor that is able to change pre-emphasis gain. Additionally, the de-emphasis gain is able to be changed by using 2-tap current source. Thus, the proposed achieves about 3.8 times higher gain than the conventional CML driver and evenly reduces power consumption up to 56.32% compared the conventional CML driver with the same of number of taps.
목차
Abstract
I. INTRODUCTION
II. Conventional CML Pre-emphasis Driver
III. Proposed CML Pre-emphasis Driver using Reconfigurable Capacitive Peaking Method
IV. RESULTS
V. CONCLUSION
REFERENCES
참고문헌 (9)
참고문헌 신청
M. Kossel, C. Menolfi, J. Weiss, P. Buchmann, G. von Bueren, L. Rodoni, T. Morf, T. Toifl, and M. Schmatz, “A T Coil-Enhanced 8.5 Gb/s High- Swing SST Transmitter in 65 nm Bulk CMOS With <-16 dB Return Loss Over 10 GHz Bandwidth,” IEEE Journal of Solid-State Circuits, Vol. 43, No. 12, pp. 2905-2920, Dec. 2008.
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J. F. Bulzacchelli et al., “A 28 Gb/s 4-tap FFE/15- tap DFE serial link transceiver in 32 nm SOI CMOS technology,” in IEEE ISSCC Dig. Tech. Papers, pp. 324?325, Feb. 2012.
J. Song, et al., “1V 10Gb/s/pin single-ended transceiver with controllable active-inductor-based driver and adaptively calibrated cascade-DFE for postLPDDR4 interfaces,” in IEEE ISSCC Dig. Tech. Papers, pp. 320-321, Feb. 2015.
A. Leon, K. Tam, and J. Shin, “A power-efficient high-throughput 32-thread SPARC processor,” IEEE Journal of Solid-State Circuits, Vol. 42, No. 1, pp. 7?16, 2007.
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