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저널정보
한국융합신호처리학회 융합신호처리학회 논문지 융합신호처리학회 논문지 제7권 제2호
발행연도
2006.1
수록면
81 - 86 (6page)

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본 논문에서는 새로운 개념의 공정 검출 회로를 제안하였다. 제안된 공정 검출 회로는 장채널 트랜지스터와 최소의 배선폭을 갖는 단채널 트랜지스터 사이의 공정변수의 차이를 비교한다. 이 회로는 공정 변이에 따라 발생하는 캐리어 이동도의 차이를 이용하여 이에 비례하는 차동 전류를 생성해 낸다. 이 방법에서는 고 이득 연산증폭기를 사용한 궤환 회로를 구현함으로써 두 개의 트랜지스터의 드레인 전압이 같아지도록 유지한다. 또한, 본 논문은 제안한 자기-바이어스 슈퍼 MOS 복합회로를 이용하여 고 이득 자기-바이어스 rail-to-rail 연산증폭기를 설계하는 새로운 방법을 소개한다. 설계된 연산증폭기의 이득은 단상의 공통모드 범위에서 100dB 이상으로 측정되었다. 최종적으로, 제안한 공정 검출 회로는 차동 VCO 회로에 직접 적용하였으며, 설계된 VCO 회로를 통해서 공정 검출 회로가 공정 코너들을 성공적으로 보상하고 광범위한 동작 영역에서 안정된 동작을 수행함을 확인할 수 있었다.
#Process compensation #Process Detection #Self-biased OP-AMP #Super MOS #VCO

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참고문헌 (11)

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B. Hosticka / 1979. / Improvement of the Gain of MOS Amplifiers sc-14 (14) : 1111 ~ 1114 google schola B. Lai / 1991. / A monolithic 622Mb/s clock extraction data retiming circuit pp. 144-145 google schola Behzad Razavi / 1999 / Design of Monolithic Phase-Locked Loops and Clock Recovery Circuits google schola Behzad Razavi / 2001 / Design of Analog CMOS Integrated Circuits google schola Benjamin Suh / 2005.June / Regulated Drain Detection and its Differential PLL Application to Compensate Process 9 (1) : 40 ~ 46 google schola

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