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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- 대한전자공학회 IEIE Transactions on Smart Processing & Computing IEIE Transactions on Smart Processing & Computing Vol.8 No.5
- 발행연도
- 2019.10
- 수록면
- 415 - 422 (8page)
- DOI
- 10.5573/IEIESPC.2019.8.5.415
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This paper presents a nonvolatile flip flop (NVFF) for fine-grained power gating with data retention. The proposed NVFF exploits the spin Hall effect (SHE) for low-power and highspeed data backup operations. In order to evaluate the performance of the proposed NVFF, a simulation framework was used that consists of a SPICE circuit simulator and a Landau-Lifshitz-Gilbert solver. This work investigates the effect of process variation on the backup-and-restore operations, and shows that the proposed NVFF can achieve <5ns backup and <2ns restore operations even under process variations in the transistor and spin Hall device. Compared to the conventional spin transfer torque–based NVFF, the proposed NVFF improves the break-even time by more than three times because of the high spin injection efficiency of SHE and the simple single-phase backup mechanism.
목차
Abstract
1. Introduction
2. Spin Hall Effect.based NVFF
3. Simulation and Results
4. Conclusion
References
참고문헌 (19)
참고문헌 신청
S. Borkar / 1999 / Design challenges of technology scaling / Proc. IEEE/ACM MICRO :23~29
S. G. Narendra / 2005 / Leakage in Nanometer CMOS Technologies / Springer
S. Li / 2009 / McPAT: An Integrated Power, Area, and Timing Modeling Framework for Multicore and Manycore Architectures / IEEE/ACM MICRO :469~480
M. Powell / 2000 / Gated-Vdd: A Circuit Technique to Reduce Leakage in Deep-Submicron Cache Memories / Proc. ACM/IEEE ISLPED :90~95
N. Sakimura / 2009 / Nonvolatile Magnetic Flip-Flop for StandbyPower-Free SoCs / IEEE Journal of Solid-State Circuits :2244~2250
S. G. Narendra / 2005 / Leakage in Nanometer CMOS Technologies / Springer
S. Li / 2009 / McPAT: An Integrated Power, Area, and Timing Modeling Framework for Multicore and Manycore Architectures / IEEE/ACM MICRO :469~480
M. Powell / 2000 / Gated-Vdd: A Circuit Technique to Reduce Leakage in Deep-Submicron Cache Memories / Proc. ACM/IEEE ISLPED :90~95
N. Sakimura / 2009 / Nonvolatile Magnetic Flip-Flop for StandbyPower-Free SoCs / IEEE Journal of Solid-State Circuits :2244~2250
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