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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 저널정보
- 대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.19 No.5
- 발행연도
- 2019.10
- 수록면
- 477 - 484 (8page)
- DOI
- 10.5573/JSTS.2019.19.5.477
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This paper presents a modified twodimensional (2D) Vernier time-to-digital converter (TDC) utilizing a novel resettable T-latch circuit for the applications of LiDAR systems. By utilizing resettable T-latches, a narrow input pulse can be converted to a high-latched output which can be reset only when the rising edge of another input pulse is detected. The proposed 2D Vernier TDC was implemented in a 0.13-㎜ CMOS process, demonstrating correct 4-bit digital code outputs within 27-meter range with 0.15-㎽ power dissipation from a single 1.2-V supply. The chip core occupies the area of 0.6 x 0.25 ㎟.
목차
Abstract
Ⅰ. INTRODUCTION
Ⅱ. CONVENTIONAL TDCS
Ⅲ. PROPOSED 2D VERNIER TDC
Ⅳ. CONCLUSIONS
REFERENCES
참고문헌 (16)
참고문헌 신청
E. Buchbinder, “Speed Detection: LADAR”, wwwee. eng.buffalo.edu/faculty/cartwright/teaching/ee49 4s99/presentations/lasar.pdf.
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L. Vercesi, L. Fanori, F. D. Bernardinis, A. Liscidini, and R. Castello, “TOF Lidar Development in Autonomous Vehicle,” IEEE Optoelectronics Global Conference, pp. 185?190, Sep. 2018.
S. G. Kim et al., “A 1.8Gb/s/ch 10mW/ch -23dB crosstalk eight-channel transimpedance ampli?er array for LADAR systems,” IEEE International SoC Design Conf., pp. 115?118, Nov. 2013.
S. Kurtti, J. Nissinen, and J. Kostamovaara, “A Wide Dynamic Range CMOS Laser Radar Receiver With a Time-Domain Walk Error Compensation Scheme, IEEE Trans. on Circuits and Systems I, vol. 64, no. 3, pp. 550?561, Mar. 2017.
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