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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2020.2
- 수록면
- 42 - 47 (6page)
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OFDM 기반 초고속 통신시스템을 위한 IFFT/FFT 프로세서는 저면적 저전력이면서 데이터 처리량이 높고 프로세싱 지연이 적어야 한다. 따라서, 파이프라인과 병렬처리를 적용한 radix-2k 알고리즘 기반 MDF(multipath delay feedback) 구조가 적합하다. 기존의 MDF 구조에서 입력신호의 워드길이에 비례하여 커지는 피드백 메모리는 면적과 전력소모가 크다. 본 논문에서는 OFDM 응용을 위한 radix-22 MDF IFFT 프로세서의 피드백 메모리 크기 감소 방법을 제안한다. MDF 구조에서 첫 두 스테이지의 피드백 메모리의 크기는 전체 피드백 메모리의 75%를 차지하므로 첫 두 스테이지의 피드백 메모리 크기 감소에 초점을 맞춘다. OFDM 전송에서 IFFT 입력신호는 변조데이터와 파일럿과 널 신호로 구성된다는 특징을 이용하여 변조데이터와 파일럿/널 신호를 각각 부호있는 정수로 매핑하여 입력신호의 워드길이를 감소시키는 방법을 제안한다. 시뮬레이션을 통해 제안한 방법이 기존 방법보다 피드백 메모리의 크기를 약 39%까지 감소시킬 수 있음을 보인다.
목차
요약
Abstract
1. 서론
2. 배경 지식
3. 제안한 방법
4. 시뮬레이션 및 성능평가
5. 결론
REFERENCES
참고문헌 (11)
참고문헌 신청
S. He / 1998 / Designing pipeline FFT processor for OFDM (de) modulation / URSI Int Symp Signals Syst Electron :257~262
2012 / Wireless LAN Medium Access Control and Physical Layer Specifications / Proc. IEEE Advanced Communication Technology, Part 15.3 :804~808
2003 / Wireless MAC and PHY Specifications for High Rate WPANs, IEEE Std 802.15.3-2003, Local and metropolitan area networks Part 15.3
T. S. Cho / 2013 / A high-speed low-complexity modified radix-2^5 FFT processor for high rate WPAN applications / IEEE Trans. VLSI Syst 21(1):187~191
S. J. Huang / 2012 / A high-throughput radix-16 FFT processor with parallel and normal input/output ordering for IEEE 802. 15. 3c systems / IEEE Tran. Circuits Sys. I 59:1752~1765
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T. S. Cho / 2013 / A high-speed low-complexity modified radix-2^5 FFT processor for high rate WPAN applications / IEEE Trans. VLSI Syst 21(1):187~191
S. J. Huang / 2012 / A high-throughput radix-16 FFT processor with parallel and normal input/output ordering for IEEE 802. 15. 3c systems / IEEE Tran. Circuits Sys. I 59:1752~1765
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