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본 논문은 팩시밀리를 위한 이진 영상 압축 표준인 JBIG2의 주요 구성모듈의 하나인 심벌 ID 코드 길이 부호화를 위한 런코드 부호기 IP를 하드웨어로 설계구현에 관한 것이다. VHDL코드 생성 및 하드웨어 합성을 위해서 ImpulseC Codeveloper와 Xilinx ISE/EDK 프로그램을 사용하였다. 합성된 하드웨어는 Xilinx사의 ML410 개발보드의 Virtex-4 FX60 FPGA에 다운로드하여 성능평가를 수행하였다. 합성된 하드웨어가 FPGA에서 차지하는 면적은 전체 slice의 13%를 차지하였다. 동작 검증을 위해 Active HDL 툴을 이용하여 각 IP에 대한 파형 검증을 수행한 결과 정상 동작함을 확인함으로써 하드웨어로의 구현에 적합성을 확인하였다. 아울러 ML410 개발보드 상에서 Microblaze CPU를 이용해 소프트웨어로만 수행한 경우와 동작 속도를 비교 한 결과, 구현된 하드웨어는 40배 이상의 빠른 처리 속도를 나타내었다. 구현된 하드웨어와 연동된 소프트웨어 모듈로 표준 CCITT문서를 압축한 결과 정상적으로 동작함을 확인하였다.
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1979 / CCITT Draft Rec. T.4, Standardization of Group 3 Facsimile Apparatus for Document Transmission
1988 / CCITT Rec. T.6, Facsimile Coding Schemes and Coding Control Function for Group 4 Facsimile Apparatus
1993 / ITU-T Rec. T.82, Information Technology - Coded Representation of Picture and Audio Information - Progressive Bi-Level Image Compression
1999 / ISO/IEC JTC1/SC29/WG1 (ITU-T SG8) N1359, JBIG2 Final Committee Draft
P.G. Howard / 1996 / AT&T JBIG2 Coder Proposal / ISO/ISE JTC1/SC29/WG1
1988 / CCITT Rec. T.6, Facsimile Coding Schemes and Coding Control Function for Group 4 Facsimile Apparatus
1993 / ITU-T Rec. T.82, Information Technology - Coded Representation of Picture and Audio Information - Progressive Bi-Level Image Compression
1999 / ISO/IEC JTC1/SC29/WG1 (ITU-T SG8) N1359, JBIG2 Final Committee Draft
P.G. Howard / 1996 / AT&T JBIG2 Coder Proposal / ISO/ISE JTC1/SC29/WG1
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