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논문 기본 정보

자료유형
학술저널
저자정보
저널정보
한국전자통신연구원 [ETRI] ETRI Journal ETRI Journal 제45권 제1호
발행연도
2023.2
수록면
150 - 162 (13page)

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The polar delta–sigma modulator (DSM) transmitter architecture exhibits good coding efficiency and can be used for software-defined radio applications. However, the necessity of high clock speed is one of the major drawbacks of using this transmitter architecture. This study proposes a low-complexity timeinterleaved architecture for the polar DSM transmitter baseband part to reduce the clock speed requirement of the polar DSM transmitter using an upsampling technique. Simulations show that using the proposed four-branch timeinterleaved polar DSM transmitter baseband part, the clock speed requirement of the transmitter is reduced by four times without degrading the signal-tonoise- and-distortion ratio.

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