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이기범 (텔레칩스) 김호준 (텔레칩스) 신민혁 (텔레칩스)
저널정보
대한전자공학회 대한전자공학회 학술대회 2024년도 대한전자공학회 하계학술대회 논문집
발행연도
2024.6
수록면
1,851 - 1,855 (5page)

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By utilizing the same hardware architecture for both inference and training of the Fully Connected Layer on edge devices, we designed an AI accelerator that shows high computational throughput of 0.102 TOPS while taking a small area. Through the reuse of feature values and feature gradients, we minimized the amount of external memory access.

목차

Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 구현
Ⅳ. 결론 및 향후 연구 방향
참고문헌

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