고성능 주문형 반도체 칩 설계를 지원하는 논리 게이트 셀 배치 및 배선 설계 자동화 개발환경 고도화

박종수

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자료유형: 학술저널

저자정보: 박종수 (목원대학교)

저널정보: ICT플랫폼학회 JOURNAL OF PLATFORM TECHNOLOGY JOURNAL OF PLATFORM TECHNOLOGY Vol.12 No.4

발행연도: 2024.8

수록면: 75 - 84 (10page)

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본 논문에서는 ASIC 반도체 칩 설계 시 활용할 수 있는 고성능 논리 게이트 셀 배치 및 배선 설계 자동화 개발환경 고도화 방안을 제안하였다. 또한 일반적으로 사용되는 3단계의 설계 단계를 9단계로 세분화하고, 세분화된 단계를 기반으로 하는 단계별 성능지표 측정기, 디자인 프로세스 모니터를 개발하였고, 이후 파라메터 기반으로 동작하는 설계 툴 별 레퍼런스 환경을 구축하고 사전에 정의된 설계 파라메터 파일과의 비교 기능을 제공하는 오토체커를 개발하였다. 제안된 설계 자동화 개발환경은 실제 제품 개발에 적용한 결과ASIC 반도체 칩 설계시에 필수로 적용해야 하는 옵션들 사용여부, 세분화된 단계별 성능지표를 가시화함으로써 디자인하우스 실무 개발자들의 숙련도에 따른 프로젝트 결과물의QoR 차이를 줄이고, 실수를 미연에 방지하여 개발기간 단축 효과도 얻을 수 있었다.

#Application-specific integrated circuit #Semiconductor chip #Place and route #Design automation #Auto-checker

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