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논문 기본 정보

자료유형
학술저널
저자정보
Byeong Yong Kong (Kongju National University)
저널정보
대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.25 No.2
발행연도
2025.4
수록면
191 - 198 (8page)
DOI
10.5573/JSTS.2025.25.2.191

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In this paper, a fault-tolerant algebraic interleaver architecture is presented for interleave division multiple access (IDMA) systems operating in harsh environments. Since the multiuser detection procedure is performed chip-by-chip according to an interleaving pattern, it is of paramount importance to keep track of the current index at all times. To protect the interleaving index in a register from soft errors, an encoder and a decoder associated with an error-correcting code are added. Moreover, to mitigate the latency overhead of such an architecture, the encoder is merged with an essential logic that precomputes the next index. As a result, the proposed interleaver tolerates soft errors while suppressing the latency overhead.

목차

Abstract
I. INTRODUCTION
II. EXISTING ARCHITECTURES
III. PROPOSED ARCHITECTURE
IV. EVALUATION
V. CONCLUSIONS
REFERENCES

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