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논문 기본 정보

자료유형
학위논문
저자정보

문지훈 (순천대학교, 順川大學校)

지도교수
오재철
발행연도
2015
저작권
순천대학교 논문은 저작권에 의해 보호받습니다.

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이 논문의 연구 히스토리 (2)

초록· 키워드

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The recent advancement of embedded devices is requiring excellent performance of processors, so the use of multi-core processor is increasing as its solution. To achieve high performance in multi-core, data is being processed by using shared memory with highest performance among IPC methods. In the case of a system using single bus, it uses memory with same shared memory for each processor core. Accordingly, it is possible to use shared memory method between processors only by modifying the data structure of OS. However, in the case of using separate bus for each processor to high performance, physical memory address used in process is different and unless a special method is used, so it does not provide data sharing method between processors.

To support shared memory in dual bus environment for each processor, memory controller that allows communication with bus connected to two processors was added. Through this controller, two processors end up having new memory area that can be accessed by both processors, and it is possible to read or write data to this address. In the case of using this memory area, most processors transmit data to different areas. Accordingly, interrupt was used in the case of recording data by creating shared memory from a particular processor to be made aware by processor that intends to read data.

For various processors to use the memory connected to memory controller, it was divided into the unit of logical segments with 4KByte in size of one segment. Memory used by memory controller is SRAM, and 4Byte register of inside process was used for the setting of whether particular memory area is being used. This register consists of 2 status bit indicating whether corresponding segment is being used and 1 direction bit indicating the information of processor currently assigned with segment. Accordingly, corresponding memory segment is being used is identified through the set-up value of this register, and the value of this register is changed with new assigned segment.

In terms of the shared memory used in this paper, list data structure was used to manage segment through which it was designed to manage segment information. Since maximum segment of shared memory is limited to 8, it used the method of removing segment with the lowest frequency of usage from data structure upon using LFU algorithm in where usable segment no longer exists.

To test the shared memory designed in this paper, it was performed in AMP method embedded Linux OS for which it was designed in shared memory controller device driver. For AMP multi-core test, Linux OS was installed in 2 processor cores.

Through the set-up of DDR and NAND memory partition used in Linux kernel, it verified that Linux OS is simultaneously executed. In addition, it verified the creation and use of shared memory by using device driver implemented to test shared memory.

목차

1. 서 론 1
1.1 연구 배경 1
1.2 연구 내용 3
1.3 논문의 구성 7
2. 멀티 코어 시스템 9
2.1 멀티 코어를 위한 공유 메모리 9
2.2 AMP 멀티 코어 시스템 15
2.2.1 듀얼 코어 시스템 15
2.2.2 주요 컨트롤러 17
3. 듀얼 버스 기반 AMP 멀티 코어 시스템 설계 51
3.1 듀얼 버스 기반 멀티코어 시스템 구성도 51
3.1.1 공용 메모리 컨트롤러 53
3.1.2 프로세서별 APB 컨트롤러 54
3.1.3 공통 APB 버스의 연결 55
3.2 듀얼 버스 기반 멀티코어 임베디드 시스템 설계 57
3.2.1 SPI를 이용한 부팅 컨트롤러 초기화 60
3.2.2 낸드 플래시 구조 및 컨트롤러 드라이버 66
3.3 공유 메모리 컨트롤러 디바이스 드라이버 73
3.3.1 논리적 공유 메모리 세그먼트 74
3.3.2 인터럽트 컨트롤러를 통한 IRQ 전달 방법 77
3.3.3 듀얼 버스 공유 메모리를 위한 자료구조 설계 79
3.3.4 공유 메모리 세그먼트 할당 81
3.3.5 공유 메모리 세그먼트 해제 83
3.3.6 공유 메모리 세그먼트 중단 85
3.3.7 공유 메모리 영역 데이터 기록 87
3.3.8 공유 메모리 컨트롤러 인터럽트 처리 91
3.3.9 공유 메모리 데이터 읽기 94
4. 듀얼 버스 기반 AMP 멀티코어 임베디드 시스템 실험 96
4.1 시스템 환경 96
4.2 임베디드 리눅스 98
4.2.1 임베디드 시스템 테스트 98
4.2.2 낸드 플래시 메모리 테스트 100
4.2.3 AMP 멀티 코어 테스트 102
4.2.4 듀얼 버스 기반 공유 메모리 컨트롤러 테스트 104
4.2.5 듀얼 버스 기반 임베디드 시스템 실험 결론 106
4.3 공유 메모리 FPGA 시뮬레이션 108
5. 결론 114
참고문헌 117

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