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고속 DRAM을 위한 Duty Cycle 보정 기능을 가진 Analog Synchronous Mirror Delay 회로의 설계
전자공학회논문지-SD
2005 .09
안전하지 않은 I/O핀 노이즈 환경에서 MCU 클럭 보호를 위한 자동 온칩 글리치 프리 백업 클럭 변환 기법
전자공학회논문지
2015 .12
디지털 감지기를 통해 전류 특성을 조절하는 아날로그 듀티 사이클 보정 회로
대한전자공학회 학술대회
2006 .06
실시간 다중 처리기 시스템을 위한 고장허용 클럭 동기 방법
(구)정보과학회논문지
1992 .11
10 ps의 해상도와 34.5ns의 입력 범위를 가진 저전력 시간-디지털 변환기의 설계
대한전자공학회 학술대회
2011 .11
변압기를 사용한 정현파 입력전류 Multi-Level Converter
대한전기학회 학술대회 논문집
2001 .04
동기 노드 클럭의 품질 측정과 클럭 위상 잡음의 컴퓨터 시뮬레이션 ( The Characterization of Synchronous Node Clock and the Computer Simulation of Clock Phase Noise )
한국통신학회 학술대회논문집
1998 .01
Digital IF용 AD변환기의 CLOCK 간섭에 대한 연구
한국통신학회 학술대회논문집
2001 .07
선택적으로 클럭 신호를 입력하는 저 전력 전류구동 디지털-아날로그 변환기
대한전자공학회 학술대회
2011 .04
Pulsed-Vdd : 클럭 네트워크가 없는 동기회로 설계
대한전자공학회 학술대회
2013 .07
Clock Distribution in High-Performance System Design
한국정보통신학회논문지
2006 .09
기준 클럭 지연을 이용한 신호 입력 정밀 시각 측정 방안 연구
대한기계학회 춘추학술대회
2015 .05
다목적실용위성3호 탑재체 CCD 제어클럭 드라이버 설계 및 시뮬레이션
항공우주기술
2009 .07
A Portable and Input-Duty-Independent Multiphase Clock Generator
대한전자공학회 ISOCC
2006 .10
다중 정현파 입력신호에 대한 최소평균사승 알고리듬의 새로운 수렴분석 ( A New Convergence Analysis of the Least Mean Fourth for the Multiple Sinusoidal Input )
대한전자공학회 학술대회
1998 .01
A 0.5–2.0 GHz Dual-Loop SAR-controlled Duty-Cycle Corrector Using a Mixed Search Algorithm
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2013 .04
싱글 클럭을 이용한 802.11a/b/n 통합 처리 수신기의 샘플링률 변환기 설계
대한전자공학회 학술대회
2010 .06
디지털 오디오 시스템의 디지털-디지털 신호 변환기 설계에 관한 연구 ( A study on the design on the digital to digital converter for Digital audio systems )
대한전자공학회 학술대회
1989 .07
인공위성 노치예측해석 및 정현파가진시험 입력도출
항공우주기술
2002 .11
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