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논문 기본 정보

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저널정보
대한전자공학회 전자공학회논문지-SD 전자공학회논문지 SD편 제39권 제8호
발행연도
2002.8
수록면
84 - 91 (8page)

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이 논문의 연구 히스토리 (7)

2008

시간제약 조건하에서 면적을 고려한 LE로 구성된 CPLD 기술 매핑
김재진 ,  장인갑 ,  허윤석 한국정보기술학회논문지 2008.06 학술저널

2005

시간 제약 조건과 면적을 고려한 효율적인 CPLD 기술 매핑
김재진 ,  이관형 한국컴퓨터정보학회논문지 2005.07 학술저널
상관관계에 의한 CLB구조의 CPLD 저전력 기술 매핑 알고리즘
김재진 ,  이관형 한국컴퓨터정보학회논문지 2005.05 학술저널

2003

면적과 지연 시간을 고려한 CLB 구조의 CPLD 저전력기술 매핑 알고리즘
김재진 ,  조남경 ,  전종식 외 1명 대한전자공학회 학술대회 2003.07 학술대회자료
CLB 구조의 CPLD 저전력 기술 매핑 알고리즘
김재진 ,  윤충모 ,  인치호 외 1명 대한전자공학회 학술대회 2003.07 학술대회자료

2002

시간 제약 조건 하에서 저전력을 고려한 CLB구조의 CPLD 기술 매핑 알고리즘
김재진 ,  김희석 전자공학회논문지-SD 2002.08 학술저널

2001

CLB를 기저로한 저전력 CPLD 기술 매핑 알고리즘
김재진 ,  인치호 ,  김희석 대한전자공학회 기타 간행물 2001.11 연구보고서

초록· 키워드

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본 논문은 시간 제약 조건 하에서 저전력을 고려한 CLB 구조의 CPLD 기술 매핑 알고리즘을 제안하였다. 제안한 알고리즘은 DAG로 구성된 회로에 대하여 각 노드들의 TD와 EP를 계산하여 분할함으로서 저전력을 수행하였다. 또한 CLB의 구조에 따라 매핑 할 수 있는 조건으로 입력과 출력의 수, OR-텀수를 고려하여 시간 제약 조건에 맞도록 매핑 가능 클러스터를 생성한다. 매핑 가능 클러스터들 중에서 저전력의 기술 매핑이 되도록 출력의 수가 가장 적은 매핑 가능 클러스터를 우선 매핑하고 시간 제약 조건에 만족하는 매핑 가능 클러스터를 선택하여 매핑 한다. 제안된 알고리즘을 벤치마크에 적용하여 실험한 결과 기존의 알고리즘인 DDMAP에 비해 46.79%, TEMPLA에 비해 24.38% 감소된 결과를 나타내었다.

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